FPGA可編程電阻技術發(fā)展前途光明

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用FPGA實現(xiàn)控制電阻系統(tǒng)設計的方法，是用軟件的方式設計硬件，并進行相應的仿真，整個系統(tǒng)集成在一個芯片上，體積小、功耗低、可靠性高，而且其內(nèi)部又有存儲單元，所以它是具有“記憶”功能。FPGA可編程電阻系統(tǒng)的硬件系統(tǒng)主要由：主控制器FPGA，鍵盤輸入電路，繼電器電阻網(wǎng)絡，輸出顯示電路四個功能模塊組成。下面是具體介紹。FPGA控制中心是整個設計的核心，主要控制實現(xiàn)對系統(tǒng)的鍵盤輸入處理，并根據(jù)輸入信息轉換成輸出數(shù)據(jù)，控制對應的繼電器吸合，從而得到不同阻值。一般可編程網(wǎng)絡主控制器由數(shù)字電路控制或單片機控制，本電路是采用FPGA控制的。近年來，EPGA被廣泛應用在集成電路中，特點是直接面向用戶，具有極大的靈活性和通用性。因此，用來設計可編程電阻的靈活性更好。

目前市場上主要生產(chǎn)FPGA產(chǎn)品的公司有Lattice、Xilinx、Altera。鑒于產(chǎn)品成本和通用性的考慮，本實驗中采用CycloneII系列，它是第二代低成本的FPGA，獨特性能體現(xiàn)在：NiosII嵌入式處理器支持，嵌入式18*18數(shù)字信號處理乘法器，中等容量的片內(nèi)存儲器(能夠滿足本設計的要求)中等速度的I/O引腳和存儲器接口。如通過鍵盤輸入一個預置值，如果輸入的數(shù)值為545.7Ω ，輸出的阻值大小就可以表示R=400+100+40+4+1+0.4+0.2+0.1。即只需將這些電阻需要接入，相應的繼電器J1、J2、J3、J5、J7、J11、J13、J15要斷開，其余的繼電器則閉合，對應的二進制代碼則為(0101 0100 0101 0111)B，通過此列可以看出用16個電阻就可以實現(xiàn)1500Ω以內(nèi)的精度可達到0.1Ω的任何電阻，使用電阻數(shù)量小，通過程序來控制電阻的接入，體積更小，同時，維護起來也更加方便，如果需要大于1500Ω的電阻，同樣可以根據(jù)此原理來增加電阻(如8000、4000、2000、1000等)，因為此設計中同時提供兩個電阻，因而還要16個同樣的電阻，原理同上(根據(jù)不同場合如要提供三組或三組以上的電阻只需相應增加即可)。

輸出顯示電路主要功能是實時顯示對應的鍵盤輸入電阻值的大小、當前工作的步數(shù)和預置時間。根據(jù)要求，本實驗采用數(shù)碼管來顯示其阻值即可，能夠滿足要求，為了顯示以上數(shù)據(jù)，每個阻值的顯示至少需要九個數(shù)碼管，其中五位用來顯示當前阻值的大小，兩位用來顯示當前的工作步數(shù)，兩位用來顯示數(shù)據(jù)的工作時間，如果采用靜態(tài)顯示控制將會需要相當多的引腳端資源(9×2×8=144個)，為了減少對FPGA引腳資源的使用，本設計中采用掃描的方式來實現(xiàn)LED的動態(tài)顯示。

教學設備同樣有FPGA實訓設備，比如實驗箱等等。

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